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링크 https://www.tomshardware.com/news/synops...or-tsmc-n5

 

 

 

미크론

 

 

Synopsys는 TSMC의 N5(5nm) 제조 기술을 사용하여 만들어질 차세대 SoC (시스템 온 칩)용 DDR5/DDR4 물리적 인터페이스(PHY) 및 컨트롤러를 제공하기 시작했습니다 . IP 패키지를 통해 SoC 제조업체는 TSMC의 N5 노드를 사용하여 제조할 칩 세트에 두 가지 유형의 메모리에 대한 지원을 추가할 수 있습니다. Synopsys는 최대 6400MT/s의 데이터 전송 속도로 DDR4와 DDR5를 모두 지원하는 메모리 솔루션을 제공하는 최초의 IP 회사입니다.

 

DDR5/DDR4 메모리 구현을 위한 Synopsys의 DesignWare IP 패키지는 다소 고급입니다. 여기에는  명령 스케줄러, 메모리 프로토콜 처리기, 선택적 ECC 메모리 , 이중 채널 지원 및 PHY에 대한 DFI 5.0 인터페이스를 특징으로 하는 DDR5/DDR4 컨트롤러 가 포함됩니다   . 이 블록은 읽기를 위한 64개의 CAM 항목, 쓰기를 위한 64개의 CAM 항목 및 8클럭 사이클의 낮은 대기 시간을 지원합니다. 컨트롤러는 Arm의 AMBA 3.0 APB 인터페이스를 사용하여 프로그래밍할 수 있습니다. 또한 이 회사는  실리콘으로 입증된 DDR5/DDR4 물리 계층을 제공합니다  ( Design & Reuse 를 통해 ) 최대 6400MT/s의 데이터 전송 속도와 최대 4개의 물리적 순위가 있는 메모리 하위 시스템을 지원합니다. 분명히 컨트롤러와 PHY는 DDR4 및 DDR5의 모든 JEDEC 표준 기능을 지원합니다. 

 

Synopsys가 제공하는 IP 패키지는 다양한 칩(CPU, SoC, SSD 컨트롤러 등)의 개발자가 컨트롤러 IP 및 물리적 인터페이스를 N5 설계에 던진 다음 회사에서 설계한 검증 IP를 사용하여 모든 것이 올바르게 작동하는지 확인할 수 있도록 합니다. .  

 

 

시놉시스


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